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楼主: damonzhao

[讨论] 后端基本概念讨论专用贴

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发表于 2014-4-9 14:09:34 | 显示全部楼层
请问做后端的“DI工程师”主要需要做什么?
发表于 2014-4-10 15:05:48 | 显示全部楼层
想问问Astro中 “ataDefineSyncPin” 这个命令到底是什么作用?是让某个Implicit ignored sink pin被定义成Sync Pin的作用,还是可以实现让几个reg同时触发的作用?
命令 ataDefineSyncPin (geGetEditCell) "cell name" '(( "端口" "rr" 0 0 0 )) 中rr 是指什么? 0 0 0是指min, typical, max三个条件都无延时吗?
发表于 2014-4-13 20:04:02 | 显示全部楼层
LEF文件我有些不理解,我看资料的理解是它是由版图抽象得来的文件,但是为什么资料又说它定义单元的位置面积等等供布局时使用?单元LEF文件的作用到底是什么?什么时候用到?
发表于 2014-4-17 07:48:59 | 显示全部楼层
大家好  以一个非门为例,transition time  是指输入A 到 输出B 的时间  0 到 1 就是 r    1到0就是f   对吧?  
        按这个解释 这个
发表于 2014-4-17 07:51:36 | 显示全部楼层
大家好  以一个非门为例,transition time  是指输入A 到 输出B 的时间  0 到 1 就是 r    1到0就是f   对吧?  
         按这个解释 这个tran time  应该只是  cell 内部的问题  而且都是固定的值,怎么会有  tran 违例一说呢, 我看到report 里面 报的 违例 反相器的 input 、out 都有!  ?
发表于 2014-4-19 14:49:15 | 显示全部楼层
回复 317# nathan_ruan


   一个器件的输入有驱动吧,它有输出负载吧,不同的驱动不同的负载,它的transition time 自然就不一样啊。
发表于 2014-4-19 14:50:43 | 显示全部楼层
回复 302# wrxs

db: 是ICC用到的库文件.v:就是Verilog代码啊
edif: 是综合后生成的文件
直接百度就能找到答案啊。。,
发表于 2014-4-19 14:52:46 | 显示全部楼层
回复 315# mayiyangyang


   LEF是抽象的版图,EDI工具一开始工作就要用到它
发表于 2014-4-20 22:32:31 | 显示全部楼层
回复 318# wjchuan


    谢谢  明白了,就是loading 不一样;
发表于 2014-4-21 11:25:44 | 显示全部楼层
我想问几个有关lowe power的概念问题,比如mtcmos,ISO cell,level shifter这些cell什么时候用到,连线怎么连,应该place在什么地方,能插buffer吗?
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