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verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

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发表于 2006-2-19 23:03:17 | 显示全部楼层 |阅读模式

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我事一个新人  想学一下   请问哪一个以后比较有前途?
发表于 2006-2-20 12:49:34 | 显示全部楼层
***** 版主模式 *****
该贴子是管理员从<a href=forums.cgi?forum=10>单片机开发</a>转移过来的!
发表于 2006-5-20 22:06:38 | 显示全部楼层

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

verilog
发表于 2006-5-21 15:22:34 | 显示全部楼层

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

这个问题就好像软件开发人员的新手整天争论C++和JAVA哪个更好一样:一点意义都没有~~
发表于 2006-5-21 15:51:34 | 显示全部楼层

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

VERILOG好学点。
发表于 2006-5-21 19:51:53 | 显示全部楼层

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

verilog 和C语言很相近,VHDL和PASCAL语言很相近。verilog相对较灵活一些,VHDL相对要严谨一些。两种语言是相通和可以互相转换的,学好了一门,再看另一个可能只需要几天时间就够了
发表于 2006-6-18 20:43:16 | 显示全部楼层

verilog hdl 和vhdl哪一个以后比较有用呀?请各位大侠指教

用的企业不相同 
二者没有区别
不过VHDL语法较难吧  
呵呵 班门弄斧了
发表于 2006-8-3 20:10:23 | 显示全部楼层
工业上一般是用verilog吧。
VHDL学起来比较郁闷,过于严谨,主要是军事上和高校里用的多吧。
发表于 2006-8-4 17:31:00 | 显示全部楼层
学会Verilog,看懂VHDL
发表于 2006-8-5 10:29:28 | 显示全部楼层
前一个吧,好像是
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