该学哪门语言？SystemVerilog VS SystemC

yx9527 · 发表于 2018-4-22 09:44:24

回复 1# albe2t

没用的，HLS是趋势

wang_wangrui64 · 发表于 2018-11-22 10:25:32

用systemverilog！！！！！！1

Lovely_god · 发表于 2018-11-24 10:49:47

看了一下，我也是打算学SV的

rango_1 · 发表于 2019-1-24 23:43:36

system verilog

C_handle_R · 发表于 2019-2-2 22:52:55

小白开始先学哪个好？

richuou · 发表于 2019-2-22 22:23:01

system verilog

number110011 · 发表于 2019-6-9 00:22:14

验证的肯定sv呀

csgood · 发表于 2019-7-27 15:02:57

做数字设计相关，不可能完全不懂systemverilog, 基础中的基础。

河畔柳树 · 发表于 2019-8-19 16:04:15

当然是sv啦

zhuangman56 · 发表于 2019-8-27 15:33:24

学习学习

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