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楼主: albe2t

[求助] 该学哪门语言？SystemVerilog VS SystemC

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onearangel
发表于 2014-4-10 08:14:25 | 显示全部楼层
必须的SystemVerilog啊
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hzx1624
发表于 2014-5-2 20:21:49 | 显示全部楼层
sv，欢迎一起交流交流
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zhaolightlee
发表于 2014-5-21 10:05:28 | 显示全部楼层
支持systemVerilog
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amty0123
发表于 2014-5-25 18:31:12 | 显示全部楼层
systemverilog比較像印體
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yishiliu
发表于 2014-6-7 22:56:25 | 显示全部楼层
一起学习
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zhaowenzhe
发表于 2014-6-9 00:38:38 | 显示全部楼层
是啊。做验证的一整套工具。
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笑泪
发表于 2014-6-10 23:02:08 | 显示全部楼层
个人觉得SV
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guodaqn
发表于 2014-7-20 16:46:27 | 显示全部楼层
对这两种语言不了解
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suntreekim
发表于 2014-8-13 03:10:46 | 显示全部楼层
很多大公司好像都用SV
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yucaoxilin
发表于 2014-8-22 13:01:56 | 显示全部楼层
在学SystemC，做建模……
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