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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL？

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发表于 2017-11-6 17:00:10 | 显示全部楼层
Systemverilog
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发表于 2017-11-21 15:02:25 | 显示全部楼层
VHDL用得多一些
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发表于 2017-11-27 20:10:52 | 显示全部楼层
verilog
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发表于 2017-11-29 16:27:09 | 显示全部楼层
vhdl, verilog 都用
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ylss1234
发表于 2017-11-30 03:51:03 | 显示全部楼层
%刚刚g哈哈哈呵呵叫姐姐
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发表于 2017-12-1 10:37:24 | 显示全部楼层
還是verilog較方便!
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发表于 2017-12-6 02:01:14 | 显示全部楼层
Thank you.
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涂满
发表于 2018-1-8 13:57:33 | 显示全部楼层
只会verilog
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发表于 2018-1-9 14:30:51 | 显示全部楼层
Verilog比较好用
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zachie
发表于 2018-1-22 15:53:58 | 显示全部楼层
两个语言都可以，VHDL略微适合大规模程序维护。
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