你是用VHDL还是用Verilog HDL？

xatull · 发表于 2013-11-25 10:19:21

verilog，这个比较容易上手

德风劲草 · 发表于 2013-12-3 16:47:43

学校讲授的是Verilog，所以一直在用。

ryan_qing · 发表于 2013-12-4 13:25:07

测试激励主要用verilog，RTL主要用VHDL

brxue · 发表于 2013-12-20 11:25:06

现在还有人用vhdl吗？

yasics · 发表于 2013-12-20 15:16:48

verilog，顺手

xiuqi180 · 发表于 2013-12-23 09:03:05

两种我都用

隔壁村的酱油 · 发表于 2013-12-26 20:54:49

verilog

lgg603 · 发表于 2014-1-3 23:11:35

用Verilog

woyizhanshen · 发表于 2014-1-6 14:34:40

现在大部分都是verilog吧

城南旧事轩 · 发表于 2014-1-13 18:36:53

本来用verilog，后来因为用DSP Builder，又学的VHDL

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