你是用VHDL还是用Verilog HDL？

jiee · 发表于 2014-1-18 23:45:37

verilog简洁，上手快

blacktiger · 发表于 2014-1-19 17:49:01

还是用verilog多些~~

a294558772 · 发表于 2014-1-21 12:35:08

学校里学习的VHDL，工作后用的verilog

songzifeng · 发表于 2014-1-21 16:12:35

感觉verilog更灵活一些，vhdl用着不顺手啊，可能是我vhdl用的还
不多把

liuyangqwin2 · 发表于 2014-1-22 10:17:53

veriog 主流

ArcherLing · 发表于 2014-1-22 10:50:47

verilog for sure

liily · 发表于 2014-1-22 21:21:48

我vhdl,同事verilog

paul21st · 发表于 2014-1-29 17:06:38

chabuduo

maverick28229 · 发表于 2014-2-13 13:59:52

most VHDL

荆棘鸟OO · 发表于 2014-2-13 14:32:34

现在基本都用verilog

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