你是用VHDL还是用Verilog HDL？

wuqiuyu · 发表于 2012-12-1 10:59:42

本来用的Verilog，现在项目改用VHDL了

rcdevice · 发表于 2012-12-2 15:19:15

欧洲国家用VHDL比较多

rooti · 发表于 2012-12-15 00:27:49

什么区别？不是一样的吗？

zgje40 · 发表于 2012-12-16 15:03:12

Verilog比较容易上手

robtu328 · 发表于 2012-12-20 00:33:54

Verilog用的很習慣了，加上SYSTEM VERILOG，VERILOG應該無敵了

薇儿安蓝 · 发表于 2012-12-20 08:55:49

Verilog HDL

加油99 · 发表于 2012-12-20 10:31:07

个人赞成verilog，但是为了与别人的接口，不得不用vhdl。verilog像c++，语法好理解、记忆。

ksqnhm · 发表于 2012-12-28 10:43:16

这样说的话，估计还是得换成用verilog了。

gelu · 发表于 2012-12-28 12:09:48

看来verilog占据统治地位啊

milktea · 发表于 2012-12-28 18:02:37

都用过，但主要还是用verilog

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