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楼主: post_design

[原创] vim插件：提高Verilog和UVM testbench coding效率的利器

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tiennguyen
发表于 2018-3-4 12:00:27 | 显示全部楼层
thanks
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WHHHHHC
发表于 2018-3-9 21:17:35 | 显示全部楼层
谢谢分享！！
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QQben
发表于 2018-3-12 13:00:39 | 显示全部楼层
xxfxfxfxff
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chaozhanghu
发表于 2018-7-22 07:53:01 | 显示全部楼层
回复 1# post_design
谢谢
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dioporco
发表于 2018-7-22 18:37:32 | 显示全部楼层
interesting
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dioporco
发表于 2018-7-22 18:38:36 | 显示全部楼层
thank you
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gongx16
发表于 2018-7-22 19:36:22 | 显示全部楼层
谢谢分享
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cyljbhw
发表于 2018-7-22 21:57:13 | 显示全部楼层
感谢 分享
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chaozhanghu
发表于 2018-7-26 18:59:43 | 显示全部楼层
haohaohao
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jinjiahao
发表于 2019-3-21 14:21:56 | 显示全部楼层
在SRC文件夹里  我好想少文件macro.pl啊
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