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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VerilogHDL及其Testbench编写方法
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楼主: maxidy

VerilogHDL及其Testbench编写方法

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yaoayao103
发表于 2009-5-12 08:57:19 | 显示全部楼层
下来看看,也许会有用的啊
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yzaichao
发表于 2009-5-15 10:18:51 | 显示全部楼层
谢谢你
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313844990
发表于 2009-5-17 15:30:36 | 显示全部楼层
学习中
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sea19150734
发表于 2009-5-17 22:18:14 | 显示全部楼层

good!good!

发的挺好的!
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huifeidemao
发表于 2009-5-19 16:24:54 | 显示全部楼层
很不错，谢谢~
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shadow920
发表于 2009-5-24 19:56:05 | 显示全部楼层
正需要，谢谢啦
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dajiangjun13
发表于 2009-6-7 11:29:40 | 显示全部楼层
very good !thank you
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diss2008
发表于 2009-6-8 01:44:42 | 显示全部楼层
好东东！！
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tx_311
发表于 2009-6-8 11:07:35 | 显示全部楼层

非常感谢啊

感谢。
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zouyun8023
发表于 2009-6-8 18:58:52 | 显示全部楼层
thanks for sharing
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