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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VerilogHDL及其Testbench编写方法
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楼主: maxidy

VerilogHDL及其Testbench编写方法

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xiaokaaabbccdd
发表于 2009-10-13 19:43:49 | 显示全部楼层
好东西 看看啊
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PangYu
发表于 2009-10-14 19:23:04 | 显示全部楼层
FSM-Based Digital Design Using Verilog HDL
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chu
发表于 2009-10-14 19:31:03 | 显示全部楼层
好书真多啊。
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ajie0608
发表于 2009-10-18 22:17:48 | 显示全部楼层
多谢楼主分享~~~
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likenature
发表于 2009-10-19 03:00:10 | 显示全部楼层
好东西下来看看。
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likenature
发表于 2009-10-19 03:02:32 | 显示全部楼层
我用的ISE10.0感觉里面TESTBENCH的讲解有些老了。个人意见。
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fento
发表于 2009-10-19 09:02:33 | 显示全部楼层
感谢分享~
下载来学习看看~
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einsamkeittt
发表于 2009-10-24 01:07:24 | 显示全部楼层
很好，谢谢
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chibijia
发表于 2009-10-24 20:48:24 | 显示全部楼层
哦，大家评价都很高啊！
看来好东西了1
先多谢楼主了！
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s14432
发表于 2009-10-25 07:53:17 | 显示全部楼层
看看,thank
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