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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VerilogHDL及其Testbench编写方法
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楼主: maxidy

VerilogHDL及其Testbench编写方法

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achi
发表于 2009-10-27 10:45:14 | 显示全部楼层
好东西，值得下载
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chengweidlmu
发表于 2009-10-27 19:34:24 | 显示全部楼层
下下来看看 非常感谢
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aluzy013
发表于 2009-10-28 17:27:51 | 显示全部楼层
太简单了
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qiudehua2009
发表于 2009-11-11 15:37:58 | 显示全部楼层
Thanks for sharing!
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ivan916
发表于 2009-11-11 16:14:24 | 显示全部楼层
xiexie!
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Boring_Ding
发表于 2009-11-11 22:07:51 | 显示全部楼层
woding!!!
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jetfish
发表于 2009-11-19 14:08:10 | 显示全部楼层
好太好了正式好
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yves277
发表于 2009-11-19 17:02:36 | 显示全部楼层
tai hao le
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yong1362121
发表于 2009-11-20 21:16:49 | 显示全部楼层
谢谢
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rab2002
发表于 2009-11-25 01:26:12 | 显示全部楼层
不会是EDA先锋工作室出版的那本书的某个章节吧
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