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[讨论] 关于为什么后端在CTS时,要尽量把skew做小  ...2 xingyun666666 2016-4-14 1510842 兔子IC 2023-3-23 16:09
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[讨论] 请教下,100平方左右的top,pr的run time正常是要多久跑一轮?  ...2 xingyun666666 2023-3-3 152487 gaishiqicai 2023-3-20 10:48
[讨论] DC综合进阶问题——深入探讨脚本综合一些细节问题  ...234 Synopsys-IC 2013-3-20 3626855 active 2023-3-20 09:42
[讨论] PR一般有哪些敏感信号,需要有spacing和shiel要求 xingyun666666 2023-3-15 6960 voiluce 2023-3-16 11:45
[讨论] 请教几个后端问题 xingyun666666 2023-3-9 51146 voiluce 2023-3-14 08:28
[讨论] clamp cell xingyun666666 2023-3-13 0972 xingyun666666 2023-3-13 11:50
[讨论] 后端流程中间修改了sdc,哪些流程需要重新跑 lixuhui112 2023-3-9 4953 voiluce 2023-3-9 19:48
[讨论] 后端的两个疑问 xingyun666666 2023-3-8 71279 jake 2023-3-9 10:52
[讨论] 数字模块怎么在virtuoso中用calibre跑drc和lvs 荒何 2023-3-3 41099 xiaoshunzi19 2023-3-8 15:59
[讨论] 在inn中,加shield,一般都是加VSS?那加VDD和VSS有什么区别吗? xingyun666666 2023-3-7 3914 xingyun666666 2023-3-7 13:54
[讨论] PODE 等概念的理解和资料查询 wenfangsibao 2021-2-5 52533 小兔图 2023-3-7 10:34
[讨论] 请问大家在calibre跑DRC时,出现这种错误是怎么回事  ...23 荒何 2023-3-1 222902 voiluce 2023-3-6 22:57
[讨论] 一个项目开始,我们从哪些角度考虑,要不要用Htree?有没有必要用Htree xingyun666666 2023-3-6 0839 xingyun666666 2023-3-6 18:03
[讨论] 我们一般CCD时,是不是都会通过option把io给设掉?让Io不做useful skew? xingyun666666 2023-3-6 0937 xingyun666666 2023-3-6 17:55
[讨论] 关于DCT读入floorplan的DEF的问题  ...2 牧月 2012-3-13 106601 551131519 2023-3-2 14:23
[讨论] 将ICC 导出的gds文件 导入 Virtuoso 中找不到standard cell attach_img 荒何 2023-2-24 91160 voiluce 2023-2-27 20:56
[讨论] 请问大家在做PT——chcek_timing时提示有10个端口没有驱动是怎么解决的  ...2 荒何 2023-2-21 131816 voiluce 2023-2-23 23:53
[讨论] 请问大家设计芯片在做完布局布线和静态时序分析后,怎么衡量设计的这个芯片的工作速度 荒何 2023-2-22 5896 hzhou 2023-2-23 17:03
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[讨论] PT中关于timing_report_unconstrained_paths_from_nontimed_startpoint的理解 gogosquid 2023-2-10 3850 gogosquid 2023-2-21 10:13
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