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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 4 |主题: 31145|排名: 9

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请教各位大虾，使用XILINX生成FIFO时应该使用Block RAM 还是Distributed RAM? (无内容	jamyce 2004-2-25	98097	wy0619 2011-8-17 12:37
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[求助] Xilinx EDKchipscope	飞的更高8 2011-8-14	15141	飞的更高8 2011-8-16 20:50
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[求助] EDK中的软件部分到modelsim中仿真输出老是为0啊，不知道哪出了问题	kellyme 2010-10-28	44424	飞的更高8 2011-8-16 16:54
[求助] TDP Memory	sunyuanxin 2011-7-25	22050	gangersun 2011-8-16 13:45
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[求助] 为什么全局时钟可以提供无偏斜的时钟信号？ ...2	cleocss 2010-8-12	125570	651673157 2011-8-16 10:26
[求助] 对于set_max_delay这个约束的一点疑问, 请大大解惑。	chris_li 2011-8-13	48448	ertss 2011-8-16 10:22
[原创] 请教开发板上的usb	xiangeryong333 2011-8-13	23009	xiangeryong333 2011-8-16 09:46
[求助] 给FPGA的某个io输入高阻态，FPGA检测到的是什么？	psd0208 2011-7-20	98188	gangersun 2011-8-16 08:15
[求助] ISE 使用方法请教	leozh 2011-8-15	43046	leozh 2011-8-15 22:02
[求助] 请教形式验证的问题	lordback 2011-6-14	22493	cocoqoo 2011-8-15 20:50
[原创] 请教：xilinxFPGA中能否实现分级时钟约束？ ...2	huhululu1 2009-12-31	175729	addr 2011-8-15 20:38
[讨论] lx9这款板子有点太矬了吧	wanna 2011-7-12	85947	zhlwsh 2011-8-15 14:28
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