在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[资料] SystemVerilog_Symposium_2019 新人帖 vantan2710 2019-4-25 82242 cdting 2019-8-3 10:59
[资料] systemverilog_for_design_2nd 305531666 2019-7-1 61923 cdting 2019-8-3 10:41
[求助] 如何在Linux下安裝並破解modelsim10.1.c 新人帖 dreamer180 2019-8-1 21668 thjan65 2019-8-2 23:08
FPGA与88E1111千兆以太网实现—软件2(收发UDP协议序) 精华3  ...2 topggmq 2014-11-27 199871 荒漠小草 2019-8-2 16:44
[求助] PCIE 接口的参考时钟p/n反了 会影响设备识别么? kangqiaoyibie 2019-7-25 22961 shiyinjita 2019-8-2 15:52
基于FPGA的全数字锁相环设计  ...23456..10 晨光一缕 2009-6-27 9627185 华胥之国 2019-8-2 14:55
[资料] ASIC、ASSP、SoC 和 FPGA之间的区别 shumanjun 2017-7-15 53076 华胥之国 2019-8-2 14:54
[求助] Matlab INCISIVE 混合仿真问题 ? daxueliujisheng 2019-8-2 01687 daxueliujisheng 2019-8-2 14:26
哪位有spartan3的xc3s1500-4fg456c的layout库文件? dinkboy 2004-12-26 12672 fjz0002 2019-8-2 13:48
[求助] verilog的敏感信号列表疑问 freebigfish 2019-8-2 22966 freebigfish 2019-8-2 13:13
[求助] makefile求助 zsj230713 2019-8-2 01688 zsj230713 2019-8-2 09:48
[原创] XILINX的GTX GTP等收发器应用领域有哪些 ? american007 2019-7-20 11328 wanghl_beijing 2019-8-1 22:05
[原创] XILINX_UltraFast™ 设计方法简介 PALLETS 2017-9-14 32149 fenlido 2019-8-1 16:42
请教modelsim vs VCS  ...23456 老扁 2003-11-17 5025325 dreamer180 2019-8-1 10:54
[求助] 关于 Xilinx SDK 在创建外设模块时,编译不通过的问题 xiaocheng_sky 2017-8-27 22013 azkandf 2019-7-31 11:53
[求助] 求助如何高效看datasheet 呱呱年 2019-7-25 11719 ifreeman 2019-7-31 11:01
[求助] 新装的synplify2015.09破解之后打开很慢  ...2 挂在天边的鱼 2015-11-10 147282 liulwn 2019-7-30 16:32
[求助] 如何防止DC综合过程对一些路径的逻辑进行优化 jsh111 2019-7-30 02305 jsh111 2019-7-30 15:52
[资料] 有数字前端 后端 验证 综合 架构资料视频课程 jinghexinlong 2019-7-30 01700 jinghexinlong 2019-7-30 15:13
[求助] 求教,vcs混合仿真,glbl.v文件编译进默认库,为何找不到 ? american007 2018-12-26 25113 dignity 2019-7-30 14:20
[资料] System verilog 和verilog 以及perl经典书籍  ...2 陆地巡洋舰 2019-3-11 124201 华胥之国 2019-7-29 15:49
[求助] 警告:clk_div without an associated clock assignment 怎么解决? zhpg009 2013-5-15 712090 taowu 2019-7-29 14:45
[原创] 送双目摄像头 新人帖 15295373371 2019-7-25 51962 15295373371 2019-7-29 13:40
[求助] FPGA通过蓝牙传输数据 - [已解决] tanjunjiang 2019-7-28 33324 超群天晴 2019-7-29 09:48
[求助] 求教! Phoebe.p 2019-7-26 11789 fascinate_lyd98 2019-7-29 09:15
[求助] 大家有用Cadence RTL Compiler的吗? airland 2011-6-22 73702 mp41234 2019-7-28 20:26
[讨论] Cadence RTL Compiler有类似Synopsys Designware的IP库吗  ...2 undead11 2013-9-2 117435 thomask 2019-7-28 08:51
[求助] Cadence RTL Compiler里面flatten design的问题 dragon_shen 2012-9-14 34386 thomask 2019-7-28 08:40
[求助] 为什么cadence RTL compiler会把超前进位加法器综合成行波进位加法器? he_says 2017-4-7 52592 thomask 2019-7-28 08:35
[求助] synopsis 的HAPS, Synplify , vivado之間是什麼關係? wide_road 2017-10-11 33404 mdy-郭柏荣 2019-7-26 14:37
[求助] 一道笔试题 chang75161 2016-7-10 95627 lianyazhou 2019-7-26 10:35
[资料] vivado2015 2016 license crack  ...23456..12 caoshangfei 2016-6-27 11335254 mnp55 2019-7-26 10:20
[资料] FPGA_数字电子系统设计与开发实例导航  ...23 zxopenwgb 2016-11-3 217616 燕南飞 2019-7-26 08:59
[求助] 求助delay_mode_punit 新人帖 qaz425556449 2019-7-24 12060 qaz425556449 2019-7-25 08:41
[求助] matlab中z域函数运计算相关问题求助 Silerain 2019-7-23 11851 Silerain 2019-7-24 20:26
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-9-15 05:17 , Processed in 0.031079 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块