在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
收藏本版 (145) |订阅

后端讨论区 今日: 1 |主题: 21823|排名: 5 

[求助] 在进行STA时,将design break成timing path需要多长时间? whitetiger 2012-3-15 52999 williamliwei 2012-3-25 19:28
[求助] 关于DFT的两个名词 X6J6P6 2012-3-18 12591 williamliwei 2012-3-25 19:25
[求助] 后端对scan_chain的处理问题? X6J6P6 2012-3-24 56259 asdl7562 2012-3-25 15:12
[求助] Load TDF时,路径是正确的,可是总显示no such file or directoty kounan2010 2010-4-14 54477 lgch11 2012-3-25 08:16
[求助] ASIC后端最费时间的是哪个环节啊? whitetiger 2012-3-19 94448 williamliwei 2012-3-24 19:12
[资料] 弱问: useful_skew可以局部使用, 甚至只给某几条path用吗? chris_li 2012-1-18 43199 williamliwei 2012-3-24 19:11
悬赏 DesignWare的几个问题 - [悬赏 70 信元资产]  ...2 jediai 2009-10-7 2010041 zqffdrr 2012-3-24 09:56
[求助] Calibre做LVS时出错,紧急求救! rewkie 2012-3-15 22311 max_max 2012-3-24 03:32
[求助] DC综合时遇到的问题 xhqbeyond 2012-3-23 02209 xhqbeyond 2012-3-23 20:43
[求助] 菜鸟Calibre LVS的错误求助 attach_img 894438252 2012-3-21 73446 1127208631 2012-3-23 16:02
[求助] formality 求助 jackcathy123 2012-3-22 12929 陈涛 2012-3-23 14:41
[原创] 女生 EDA软件开发or嵌入式软件开发 哪个更好 鲲鹏2012 2012-3-22 26993 half_honey 2012-3-23 09:07
[讨论] 模拟版图的难点在哪? cgy_312 2012-3-21 53554 cgy_312 2012-3-23 08:41
[求助] AStro求助(Fail to execute command) SKILLER 2012-3-22 32561 sunny_hua 2012-3-22 21:19
[求助] 请问gds做stream out的时候,如何设置到指定的文件夹? x1346 2012-3-21 32974 damonzhao 2012-3-22 14:49
[求助] 【已解决】没有tie high tie low单元时0,1怎么连接到电源和地  ...2 ppseuradio1 2012-3-16 167970 damonzhao 2012-3-22 13:58
[求助] 关于congestion问题?[已解决] attach_img X6J6P6 2012-3-21 33253 damonzhao 2012-3-22 13:29
[原创] 综合时的问题 fishinger1999 2012-3-21 32467 zhq415758192 2012-3-22 09:34
[招聘] 苏州IC公司招聘模拟、数字工程师  ...234 samuel_55 2011-7-7 3914176 samuel_55 2012-3-21 19:19
[求助] 现有的floorplan place route等用的是那些算法? whitetiger 2012-3-21 02911 whitetiger 2012-3-21 16:44
[求助] extractRC时出现,unconnected wire found at terminal ... zengt000 2012-3-20 23536 zhq415758192 2012-3-21 08:31
[讨论] encounter CTS问题 菜鸟ASIC 2012-3-15 56438 wlyj000 2012-3-20 23:50
[求助] metal fill twn2000 2012-3-20 12388 1127208631 2012-3-20 17:10
[原创] set_clock_latency tonyhard 2011-8-11 89952 陈涛 2012-3-20 13:26
[求助] 门控时钟的问题 wlyj000 2012-3-17 32383 wlyj000 2012-3-20 13:19
[求助] 如果一个设计里既有同步复位的模块又有异步复位的模块对综合有什么影响? xhqbeyond 2012-3-15 84170 xhqbeyond 2012-3-20 09:37
[求助] 求助,dc能不能报告分类资源的面积 estyzq 2012-3-14 32141 hitten 2012-3-19 23:44
[求助] Verilog 综合后与自己设计的部分相结合的问题 attach_img wlyj000 2012-3-17 82459 hitten 2012-3-19 23:42
[求助] 多时钟分析,相同时钟域的,不同的margin设置 attach_img ssliu 2012-3-19 33520 hitten 2012-3-19 23:39
[求助] DC 综合后没有标准单元库中的门网表? IAMEE 2012-3-19 12064 hitten 2012-3-19 23:35
[讨论] 门控时钟的问题 B40514066 2012-3-19 22607 hitten 2012-3-19 23:26
[求助] 双界面卡/智能卡测试软件 zjl840928 2012-3-19 02214 zjl840928 2012-3-19 23:20
[求助] encounter中的禁止布线 lh巴萨 2011-11-25 42813 混乱三千年 2012-3-19 23:00
[求助] 关于Astro自动布局Macro luanby 2012-3-17 22290 luanby 2012-3-19 21:14
[求助] DFT With 2 TK liangyefeng 2012-3-19 01847 liangyefeng 2012-3-19 21:12
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-2-21 04:47 , Processed in 0.041955 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块