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[原创] 有没有断言验证和emulator的高手呢? talktogod 2010-1-16 23368 gs2198 2014-1-14 21:53
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[求助] UVM 新手请教问题  ...2 jackyzhzh 2014-1-3 103456 dfb211 2014-1-3 13:53
[求助] put一个packet之后,一定get之后,才能继续put吗 109010118 2013-12-30 21762 109010118 2014-1-1 21:06
[求助] 请教如何建立层次画的sequence? ibrotherv1 2013-12-30 41924 ibrotherv1 2013-12-31 11:31
[原创] verilog if判断条件有关于未知值x的判断 xuhaoee 2013-12-28 76599 feiying_cq 2013-12-30 21:51
[求助] 在systemverilog中如何定义随机的自定义结构体变量 ibrotherv1 2013-12-30 11888 A1985 2013-12-30 14:07
[原创] 输入或操作 xuhaoee 2013-12-28 12034 kuolifeng 2013-12-30 11:33
[原创] ius9.2支持使用uvm1.1d版本库进行仿真么 supermanqc 2013-12-29 21863 A1985 2013-12-30 10:30
[求助] vmm_data::push_back 是什么函数 109010118 2013-12-26 21608 109010118 2013-12-29 20:48
[求助] systemverilog如何实现可变参数宏 attach_img  ...2 eesub 2013-12-10 148944 ligang1986718 2013-12-28 20:56
[原创] [求助]Modelsim6.5仿真问题  ...2 dft2009 2009-12-21 165978 thu_zgy 2013-12-27 15:43
[求助] 【共5个问题,指点讨论】关于Verilog和SV中task及其内部变量是static还是automatic sages 2013-8-15 69140 lkk1988223 2013-12-27 10:02
[求助] 请教如何设置S公司AXI Slave VIP的Read Interleave功能 xd_hg 2013-12-26 03178 xd_hg 2013-12-26 21:00
[解决] verdi license kharthik 2013-12-26 01944 kharthik 2013-12-26 19:49
[求助] 急救:sequence 中rand 的变量没有随机化出数据,是什么原因? lkk1988223 2013-12-26 21879 lkk1988223 2013-12-26 16:57
[求助] spyglass检查clock_reset时遇到的问题 milly_w 2013-5-24 12827 kharthik 2013-12-26 15:38
[求助] Modelsim 仿真遇到的问题 ogilgamesho 2012-1-14 83195 zhangkangdouble 2013-12-26 15:07
[活动] Welcome to Join in DVClub Shanghai (China). @Linkedin rickyice 2013-12-26 02553 rickyice 2013-12-26 09:10
[求助] 请教一个UVM问题望高手赐教 ibrotherv1 2013-12-24 21670 etomaster 2013-12-25 22:54
[求助] 用ncverilog做仿真,关于latch的问题 attach_img saicom 2013-12-24 11904 saicom 2013-12-24 13:26
[求助] LINUX虚拟机环境下跑modelsim 生成fsdb时出错 求助 dingliang201219 2013-7-30 22416 juyong3 2013-12-23 09:18
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