关于后仿真的问题

大暗黑天 · 发表于 2014-11-13 22:36:09

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我们做的SOC芯片，时钟网络比较复杂，时钟源也比较多，后仿真的时候给了一大堆各种配置选择下的sdf文件，每一个sdf文件仿真时都需要重新生成simv (我们用VCS)，而且现在服务器快跑死了~~内存根本不够，想问问各位高手都是怎么组织这种后仿真的。。。

A1985 · 发表于 2014-11-14 08:39:37

后仿真本来就慢。。。

coolcc19841030 · 发表于 2014-11-25 10:32:22

后仿本来就是一个需要耐性，耗时的工作，一般大的项目，基本会按BLOCK进行后仿，外围可以利用RTL等加速

逍遥亮剑 · 发表于 2014-11-28 12:36:05

这个没有遇到过。。。

diyangguang · 发表于 2014-12-1 20:43:19

不错的问题

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