新手关于约束问题的一点疑问求解答

yic2000 · 发表于 2012-7-26 17:37:40

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因为刚开始学习dc，所以主要是在看书，看文档，以及做下synopsys给的lab~

然后做完后产生了如下的疑问，因为lab里面好多数据都是它给好了的，但是我要是做自己设计的dc的时候，好多数据都该如何确定呢？
比如 input_delay，output_delay，clock_transition，clock_latency，clock_uncertainty，以及load和drive相关的数据设置~
这些设置都是如何得到的呢？
lab里面都是直接给出，也未介绍是如何得出的，是计算，还是靠经验得出的？？？

yic2000 · 发表于 2012-7-27 09:04:12

顶下~

yic2000 · 发表于 2012-7-27 12:14:16

求大神来回复啊~

陈涛 · 发表于 2012-7-27 12:15:47

搜索以前的帖子

yic2000 · 发表于 2012-7-30 08:56:30

回复 4# 陈涛

不好意思，可以给个链接或者提示下搜索什么啊？我刚收时序约束没搜到~
谢谢~

henryshen2000 · 发表于 2012-7-30 15:35:55

对呀，想搜索以前的帖子，但是没找方法！

wangsikao · 发表于 2012-7-30 16:52:40

clock_transition，clock_latency，clock_uncertainty
是经验值了，foundry长有时也会给出建议值。和时钟源的质量也有关系吧。

input delay啥的，理论上和芯片应用时，板上具体电气特性相关。
实际上，也都给个经验值。

mikiahmikiah · 发表于 2012-7-31 14:21:40

http://bbs.eetop.cn/thread-333575-1-1.html
这里面有得，都是EETOP上和我个人的总结。。

linuxlee · 发表于 2013-3-27 09:08:22

thx 我也有疑问

热水加冰 · 发表于 2013-3-27 13:39:20

thx 正需要

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