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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2014-9-24 09:39:25 | 显示全部楼层
verilog 和C比较接近,易学。
发表于 2014-9-24 23:14:37 | 显示全部楼层
主要用verilog,客户的设计有些是vhdl的,做测评时候比较蛋疼,幸亏可以混合仿真
发表于 2014-9-25 14:57:10 | 显示全部楼层
谢谢楼猪分向~~
发表于 2014-9-25 15:41:12 | 显示全部楼层
Verilog容易上手,也学过VHDL,但是忘光了
发表于 2014-9-25 22:57:42 | 显示全部楼层
vhdl 飘过
发表于 2014-10-4 15:28:34 | 显示全部楼层
VHDL
发表于 2014-10-15 13:43:15 | 显示全部楼层
verilog
发表于 2014-10-21 16:11:11 | 显示全部楼层
Verilog
发表于 2014-10-24 10:57:50 | 显示全部楼层
verilog 比较常用,VHDL还是军方用的比较多
发表于 2014-11-4 10:07:40 | 显示全部楼层
都用过,各具风格,现在Verilog多一些。
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