你是用VHDL还是用Verilog HDL？

wgej1987 · 发表于 2014-9-16 18:09:22

第一次听说公司都用VHDL。。。少年说反了把

foxfoxes · 发表于 2014-9-16 21:01:17

verilog~~~

ppsz77 · 发表于 2014-9-18 14:30:43

同学里感觉verilog用的人比vhdl多

beyond某人 · 发表于 2014-9-23 18:06:17

回复 2# benny46

那你怎么拿VHDL做后仿呢？

cqf6107848 · 发表于 2014-9-24 08:39:34

回复 1# buley

其实都用的

uudraco · 发表于 2014-9-24 09:39:25

verilog 和C比较接近，易学。

shilfer · 发表于 2014-9-24 23:14:37

主要用verilog，客户的设计有些是vhdl的，做测评时候比较蛋疼，幸亏可以混合仿真

wangj929281 · 发表于 2014-9-25 14:57:10

谢谢楼猪分向~~

luoyi · 发表于 2014-9-25 15:41:12

Verilog容易上手，也学过VHDL，但是忘光了

mfkiass · 发表于 2014-9-25 22:57:42

vhdl 飘过

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