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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2012-5-15 16:32:57 | 显示全部楼层
都差不多,两者互补!!!
发表于 2012-5-15 17:03:33 | 显示全部楼层
verilog 感觉上手快点儿。。。
发表于 2012-5-15 17:24:29 | 显示全部楼层
现在很少用VHDl吧。
发表于 2012-5-20 19:55:09 | 显示全部楼层
学校喜欢教VHDL,企业喜欢用verilog,军工行业喜欢用VHDL。上次问NASA出来的一个老外,据他说NASA用VHDL多一些
发表于 2012-5-20 21:18:50 | 显示全部楼层
当然是verilog
发表于 2012-5-23 22:08:08 | 显示全部楼层
我觉得verilog优点是简单快捷,vhdl优点是更严谨~
发表于 2012-5-24 11:01:22 | 显示全部楼层
回复 1# buley


   verilog
发表于 2012-5-28 09:29:05 | 显示全部楼层
回复 2# benny46

都差不多吧
头像被屏蔽
发表于 2012-5-28 19:31:50 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2012-5-28 23:01:07 | 显示全部楼层
直接verilog
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