2010 ISSCC All-Digital PLL Presentation File

California · 发表于 2011-2-26 15:15:16

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2010已过一年了，不知道之前是否已有人发过这几篇演讲稿？
若已有发过，大家可知会一下，本人将会按照规定删帖哈！

四篇 2010 ISSCC上All-Digital PLL Presentations:
1. [Chen,Atheros]_A Calibration-Free 800MHz Fractional-N Digital PLL with Embedded TDC
2. [Grollitsch,Infineon]_A 1.4 psrms period jitter TDC-less Fractional-N Digital PLL with Digitally Controlled Ring Oscillator in 65nm CMOS
3. [Lee,Postech]_A 1GHz ADPLL with a 1.25ps Minimum-Resolution Sub-Exponent TDC in 0.18μm CMOS
4. [Tokairin,NEC]_A 2.1-to-2.8GHz All-Digital Frequency Synthesizer with a Time-Windowed TDC

2010 ISSCC All Digital PLL Presentation.rar (7.75 MB, 下载次数: 669 )