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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 如何写好状态机（verilog）
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楼主: zhouskill

[转贴] 如何写好状态机（verilog）

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发表于 2010-11-28 23:43:12 | 显示全部楼层
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ty2004
发表于 2010-11-28 23:53:39 | 显示全部楼层
现在学还感觉有点难啊
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发表于 2010-11-29 02:08:25 | 显示全部楼层
先看看，再来发表意见。
不过先谢谢楼主的奉献精神。
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taoleite
发表于 2010-11-29 08:33:37 | 显示全部楼层
支持一下
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发表于 2010-11-30 00:49:24 | 显示全部楼层
谢谢楼主
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发表于 2010-12-1 10:23:00 | 显示全部楼层
xiexie!
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发表于 2010-12-1 10:24:58 | 显示全部楼层
回复 1# zhouskill


    谢谢！很好！
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liqz
发表于 2010-12-1 10:46:39 | 显示全部楼层
thanks for sharing
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发表于 2010-12-1 16:17:35 | 显示全部楼层
谢谢分享
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mk3
发表于 2010-12-2 20:35:22 | 显示全部楼层
好东西啊
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