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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 如何写好状态机（verilog）
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楼主: zhouskill

[转贴] 如何写好状态机（verilog）

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460656861
发表于 2010-8-10 14:36:59 | 显示全部楼层
谢谢，
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maoniuu
发表于 2010-8-10 16:41:52 | 显示全部楼层
DING.................
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xuzhongqiang
发表于 2010-8-11 08:37:53 | 显示全部楼层
谢谢分享
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future_laiwei
发表于 2010-8-27 15:00:10 | 显示全部楼层
谢谢楼主
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zhaoboyang1984
发表于 2010-8-27 16:27:34 | 显示全部楼层
很有用的资料
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wangxuede220
发表于 2010-8-28 21:53:52 | 显示全部楼层
谢谢楼主分享！
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forech
发表于 2010-9-4 11:58:47 | 显示全部楼层
支持~~~~
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stanleybeibei
发表于 2010-9-9 11:23:44 | 显示全部楼层
好帖，谢谢楼主
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zheshiwo
发表于 2010-10-1 20:57:11 | 显示全部楼层
好，谢谢！
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wangxuede220
发表于 2010-10-3 12:33:43 | 显示全部楼层
这绝对是好贴！顶起~！
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