数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 1 |主题: 30966|排名: 26

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谁给个异步FIFO的VERILOG范例学习下？ (无内容)	looneyxp 2004-5-16	82930	liuiang 2004-5-18 09:56
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求救	nauxuzhefeng 2004-5-13	45171	nauxuzhefeng 2004-5-14 10:31
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急！！！如何用64M时钟产生一个稳定的9.6K的时钟！	kylandzhy 2004-5-12	22136	shadow 2004-5-13 19:42
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modelsim问题	atuhappy 2004-5-12	81958	atuhappy 2004-5-12 17:47
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