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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 7 |主题: 31146|排名: 9

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请教一个问题，谢谢各位了！ ...2	frinos 2008-4-17	104447	nwpu_010 2008-4-19 14:26
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时钟信号能不能通过I/O引脚输入，然后通过另外一个I/O引脚输出	tomispig 2007-12-14	94495	aikezai 2008-4-17 18:04
很奇怪的问题。编译器不执行代码的逻辑，高手请进。	howardneil2007 2008-4-12	32275	国产可乐 2008-4-17 16:38
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请教个关于verilog问题	du139123456789 2008-4-13	12205	26022602 2008-4-13 18:10
ｆｆｔ　ｉｐ核，输出是实、虚及指数都为ＸＸＸ	howardneil2007 2008-4-13	12889	0451iceman 2008-4-13 13:14

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