在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[讨论] 带MAC和POWERPC硬核的XILINX芯片问题 cen00 2012-6-7 01637 cen00 2012-6-7 09:28
[求助] 请教 关于 信噪比SNR 及 SQNR的求解方法 tt99647 2012-5-12 29367 zyd912 2012-6-6 20:13
[求助] 外围模块直接连在系统总线上可行吗? GIOOIG 2012-6-6 37074 eaglelsb 2012-6-6 19:43
[讨论] spartan6多个MCB以多体交叉方式进行burst连续存取 liang5293392 2011-12-19 23154 eaglelsb 2012-6-6 19:39
[求助] 使用qartus跑FPGA实现,耗时太长,请问各位高手怎么能缩短跑FPGA的时间?? jianfeng108 2012-6-6 96031 pornanier 2012-6-6 18:25
[求助] 小白继续求教!关于外围模块地址的问题! GIOOIG 2012-6-6 11877 jacobi117 2012-6-6 18:16
Quartus定制ROM的问题 attachment  ...23 CunjieSong 2009-10-3 2110253 tangate 2012-6-6 13:53
[求助] 怎样对microblaze内部的存储器进行操作 shuhoo 2012-6-5 11857 shuhoo 2012-6-6 11:22
[求助] 求助!从ROM中读出的第一个数据占据了3个时钟? obgnahs 2012-6-5 31871 obgnahs 2012-6-6 10:51
[求助] 保存在memory中的图像读取问题 zhaow0422 2012-6-5 25025 zhaow0422 2012-6-6 10:37
[求助] 用SignalTap ii 调试遇到的一个怪事 jhjyn 2012-4-18 52609 windflood 2012-6-6 10:06
[求助] 很多人都在使用FPGA,有人能知道FPGA如何设计的吗 daniel8929 2012-5-30 72912 yucaoxilin 2012-6-6 09:57
[求助] 仿真中的乘法器调用的问题 xingtianhn 2012-6-5 32401 mosou 2012-6-6 09:03
[讨论] 多通道的AD采样如何做到数据同步? sharbioue 2012-4-26 36086 Timme 2012-6-5 22:33
[求助] 为什么安装好matlab和dsp_builder之后看不到dsp的库? attach_img ohgreat 2012-5-22 22194 pornanier 2012-6-5 21:54
[求助] 求助:PCIE 硬核IP 怎么用起来?能给点指点吗? qlc111 2012-6-4 22138 qlc111 2012-6-5 17:35
[求助] 求助!rom调用时只能读取两个数 obgnahs 2012-6-5 62409 obgnahs 2012-6-5 14:38
[求助] 求maxII 570的应用原理图 jack5230 2012-6-5 05863 jack5230 2012-6-5 11:37
[求助] USB2.0 high speed 模式下,USB PHY是如何采样480Mb/s的数据? llh1119 2012-5-21 22341 windflood 2012-6-5 11:35
[求助] 一般一个电路的Timing slack有多少啊? trueif 2012-6-1 42162 教父 2012-6-5 10:47
[求助] 请教高手关于uvm验证方法学的学习入门 wangxuede220 2011-11-21 65237 shoufengxima 2012-6-4 23:26
[求助] 仿真成功 实验无结果 求教 attachment tjy389945230 2012-6-4 42024 nuclearpower102 2012-6-4 23:17
[求助] 仿真中的乘法器调用怎么不起作用 xingtianhn 2012-6-4 01930 xingtianhn 2012-6-4 20:39
[转贴] fpga的前途  ...234 wbs605697131 2010-4-1 3817324 yucaoxilin 2012-6-4 19:55
[求助] 请教:FPGA 如何功耗分析 sara0830 2011-11-17 74101 yucaoxilin 2012-6-4 16:44
[求助] 关于signalTap采样时钟的疑问 attach_img  ...2 becoll 2009-12-15 1811131 zbf_sjtu 2012-6-4 14:36
SignalTap II has too many fan-outs问题 qingfan886 2009-1-5 14055 zbf_sjtu 2012-6-4 14:27
请问高手MATLAB与VERILOG的问题  ...2 xiazgjay 2007-11-25 135086 Lfantasy 2012-6-4 10:00
CPLD和FPGA内部结构有何不同 mihayilov 2009-7-30 84755 梦之幽蓝 2012-6-3 16:29
[求助] 关于组合逻辑产生latch的一段代码,请大家帮忙分析 daboboxiao 2012-6-2 52693 daboboxiao 2012-6-3 15:13
[求助] ISE为什么会报异步时钟的时序违例呢?这两个clock已经指定不同的group了。【已解决】 wangxuede220 2012-6-1 24787 wangxuede220 2012-6-3 13:46
[求助] 利用verilog 实现CCD的控制 这程序编译时有32个错误 请高手矫正 attach_img  ...2 tanliming007 2012-6-1 145487 tanliming007 2012-6-2 19:42
[求助] Isim里如何做后仿? benny46 2012-6-2 02411 benny46 2012-6-2 11:01
[解决] 时钟分频 lizhaohong520@ 2012-5-31 32715 lizhaohong520@ 2012-6-1 16:43
[讨论] verilog中generate的用法(genvar)  ...2 mhfweng 2010-9-10 1214852 chen.terry 2012-6-1 11:31
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

X

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-5-28 03:09 , Processed in 0.059374 second(s), 9 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块