在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[求助] chipscope14.7 无法连接 但IMPACT烧写正常 royy27 2016-1-6 44773 lunmag 2016-1-7 09:44
[求助] 关于sdc约束的小问题 天蝎座杀羊 2016-1-4 53285 nickyanghy 2016-1-7 09:39
[讨论] 内部配置访问接口 (ICAP) 具体是个什么东东呢? ttxs2009 2014-6-15 14776 nickyanghy 2016-1-7 09:34
[求助] 海思与兆易offer比较 vickifighting 2016-1-7 23221 whz7783478 2016-1-7 09:16
[原创] Mentor Graphics ModelSim SE 10.4 landro 2016-1-6 22959 weigaozu 2016-1-7 08:28
[求助] 关于cpld中的复位问题 天蝎座杀羊 2016-1-5 22552 天蝎座杀羊 2016-1-6 22:48
[求助] 关于Vivado的SDK program FPGA failed lujigua 2016-1-6 02884 lujigua 2016-1-6 22:03
[求助] synplify2015在technical view中查看clock tree时崩溃 schottky163 2016-1-5 22367 acgoal 2016-1-6 18:29
[原创] FPGA Ebook jackpot 2015-12-22 11952 kungfu1st 2016-1-6 17:11
[解决] rhel6.5+Verdi11 64bit仿真 pctanyicheng 2015-1-27 53218 kungfu1st 2016-1-6 17:10
[求助] ISE14.4加上CDC文件,编译后报如下错误,咋办啊? ccttvv 2015-12-27 44062 kungfu1st 2016-1-6 17:08
[求助] rapidio 1.7仿真问题求助 qinzhanao 2015-12-30 22490 kungfu1st 2016-1-6 17:07
[求助] 求最新Verdi3及完全破解  ...23 ccchunyu2652 2012-10-16 2521697 kungfu1st 2016-1-6 17:02
[求助] 使用Debussy的疑难问题 huangxjmail 2016-1-6 02454 huangxjmail 2016-1-6 14:19
[求助] 关于syn_keep yuxueqiu123 2016-1-6 02038 yuxueqiu123 2016-1-6 10:07
[求助]关于使用xilinx的ISE进行布线的问题  ...2 dedrty 2004-12-17 116529 叮霖霖 2016-1-6 09:33
[求助] FIE滤波器信号源问题 cfpdl 2016-1-5 62775 cfpdl 2016-1-6 09:22
[求助] 最近在做pcie,不知道怎么仿真IP核生成的例子 li869725671 2015-12-28 72924 guyefeng123321 2016-1-5 22:51
[求助] 分频时钟需要同步吗? chevroletss 2016-1-4 76667 guyefeng123321 2016-1-5 22:47
[求助] fpga rapidio 板级测试 zhouyu007com 2015-6-26 23370 guyefeng123321 2016-1-5 22:42
[求助] 在FPGA上实现以太网(做MAC),请问需要看哪个标准的哪一部分  ...2 djqlyy2922 2013-7-9 109652 chenxumeng 2016-1-5 21:52
[求助] XILINX自带的PIO仿真数据不正确 li869725671 2016-1-5 01556 li869725671 2016-1-5 21:37
[求助] 多相滤波抽取 feiyuzhuxian 2016-1-5 03062 feiyuzhuxian 2016-1-5 16:59
高速乘法器的性能比较  ...23 wice3 2007-2-3 269293 血溶伊剑 2016-1-5 15:08
[求助] 关于nlint的问题,遇到了interface位宽报错 lookout~ 2016-1-5 02234 lookout~ 2016-1-5 12:13
[求助] 锁相环 超前滞后滤波器的规格化曲线怎么得来的 无相 2016-1-5 01530 无相 2016-1-5 11:37
[解决] 关于include生明位置的问题 huyongwei01 2016-1-5 02476 huyongwei01 2016-1-5 11:26
[调查] Verilog_XL加密的文件如何解密呢 fl_5588 2012-12-3 98123 freeren_liming 2016-1-5 09:42
[求助] 弱问: 公司内部为何还要加密verilog成*.vp文件 chris_li 2011-4-13 88652 freeren_liming 2016-1-5 09:33
用SYNPLIFY综合一个ROM程序时出现问题 wjx197733 2004-8-9 84663 guhaiming 2016-1-4 19:54
[求助] 请教一下关于如何配置VCS客户端才能从网络上直接获得授权 yexingqi 2016-1-4 01928 yexingqi 2016-1-4 19:46
[资料] ADV7610 HDMI1.4 解码接收器 低功耗 小尺寸 blackboat_2008 2016-1-4 02455 blackboat_2008 2016-1-4 18:01
[求助] 现在做项目做后仿真的多吗,做到什么程度呢? kuailexiari 2015-12-30 73239 apooo 2016-1-4 15:00
[求助] xilinx的代码如何在altera的期间中用 easychen 2016-1-4 02085 easychen 2016-1-4 14:25
[求助] 各位大神,求助一下,关于generate的用法 visage518 2015-12-31 93520 南宫恨 2016-1-4 09:54
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-10-14 06:00 , Processed in 0.047464 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块