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IC验证讨论 今日: 0|主题: 6734|排名: 13 

[求助] sequence定义为参数话的类,uvm会报warning,当前的sequencer不知道和那个sequence连接 allencherry 2015-12-2 01429 allencherry 2015-12-2 08:27
[讨论] DDR3 DQS 测量到的信号的回沟比较大,跟那些原因有关 attach_img 北極企鵝 2015-10-23 32883 lazybear 2015-11-30 10:22
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[求助] 怎么解决formality验证中BBPin unmatched yanpeace 2015-7-14 14967 SKILLER 2015-11-26 09:31
[讨论] Verilog VHDL 排版插件 luoyanghero 2015-11-24 21968 haitaox 2015-11-25 09:02
[求助] 用 nc_verilog跑波形的问题~ 芹菜饺子 2015-11-24 11603 zw84611 2015-11-25 06:59
[求助] 用Modelsim仿真VHDL代码,force和noforce/release怎么使用 xiao@ping 2011-12-30 14563 王皓 2015-11-24 20:47
[求助] 请问windows下用modelsim仿真怎么一次把所有信号的波形dump出来 spirit0302 2015-8-16 22652 王皓 2015-11-24 20:36
[求助] 使用systemverilog完成仿真时钟频率的自动调整 zhouyuwo 2015-11-20 62916 gaurson 2015-11-23 22:48
[求助] uvm_do 报错,说参数类型不匹配 attachment roc2007 2015-11-13 72545 roc2007 2015-11-23 20:32
[求助] 有没有做过存储器内建自修复的 eda—wdy 2015-11-23 01227 eda—wdy 2015-11-23 19:29
[求助] usb vip svt的问题请教 duanli112 2015-11-23 02632 duanli112 2015-11-23 18:13
[求助] UVM+Vvhdl语言,经验求职 9065574912 2015-10-9 42690 zrzf23 2015-11-23 16:53
悬赏 [求助] IC5141集成calibre - [悬赏 20 信元资产] attach_img fzu_physics 2013-10-9 22107 jeffej 2015-11-22 10:56
[求助] VCS晶体管级仿真出错 qiufeng 2015-11-18 11476 shrimp_suo 2015-11-20 23:39
[求助] ncverilog不支持sv的结构体使用位置赋值吗? attach_img xinxiangbaiheqd 2015-11-18 02037 xinxiangbaiheqd 2015-11-18 16:47
[求助] questasim 的amba使用求助 duanli112 2012-9-4 95293 Ryggeor 2015-11-18 01:48
[求助] formailty设计和网表有不匹配但找不到不匹配点的对应源代码 attach_img zxxytdx 2015-11-9 11964 songw 2015-11-17 19:57
[求助] IC5141veriloga求助 yinsedexia 2015-11-16 01823 yinsedexia 2015-11-16 10:44
[求助] VCS混合编译VHDL, SV求助 rice973 2012-1-12 38229 husthxing 2015-11-15 23:12
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学习SystemC应具备的C++基本语法 tjaiwxc 2015-11-14 03725 tjaiwxc 2015-11-14 18:34
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