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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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wendzb
发表于 2019-12-3 09:05:46 | 显示全部楼层
学习下
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发表于 2019-12-3 09:46:46 | 显示全部楼层
学习下楼主的代码风格
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zxbdlv
发表于 2019-12-4 22:34:54 | 显示全部楼层
感谢分享！！！
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发表于 2019-12-8 07:58:36 | 显示全部楼层
谢谢，学习一下。
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IC-LOU
发表于 2019-12-9 12:13:03 | 显示全部楼层
谢谢楼主的分享
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发表于 2019-12-9 23:07:27 | 显示全部楼层
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柯子
发表于 2019-12-11 17:06:43 | 显示全部楼层
开始学习！

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Lycs
发表于 2019-12-11 17:50:07 | 显示全部楼层
感谢分享
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发表于 2019-12-15 01:52:34 | 显示全部楼层
看看
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发表于 2019-12-15 21:09:04 | 显示全部楼层
感谢楼主
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