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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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rawhided
发表于 2019-11-6 02:57:30 | 显示全部楼层
great..thank you
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发表于 2019-11-6 09:00:21 | 显示全部楼层
不错不错一起学习
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发表于 2019-11-6 10:53:06 | 显示全部楼层
学习....
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发表于 2019-11-6 13:55:22 | 显示全部楼层
学习学习               
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发表于 2019-11-6 16:14:53 | 显示全部楼层
感谢楼主分享~~~~~试试
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ymftian
发表于 2019-11-11 10:04:43 | 显示全部楼层
谢谢分享

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发表于 2019-11-11 10:48:30 | 显示全部楼层
Thanks
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发表于 2019-11-12 13:38:59 | 显示全部楼层
thank you !!
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发表于 2019-11-13 10:52:10 | 显示全部楼层
下来看一看
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发表于 2019-11-15 09:43:04 | 显示全部楼层
参考一下
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