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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2019-11-24 17:18:22 | 显示全部楼层
thanks
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发表于 2019-11-25 15:30:13 | 显示全部楼层
thx for sharing
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发表于 2019-11-25 22:05:06 | 显示全部楼层
谢谢楼主
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发表于 2019-11-26 10:58:13 | 显示全部楼层
goog
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ckshy
发表于 2019-11-29 08:16:29 | 显示全部楼层
谢谢分享~~
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发表于 2019-11-29 09:36:48 | 显示全部楼层

谢谢分享！
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Folier
发表于 2019-11-29 10:43:55 | 显示全部楼层
谢谢分享！

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发表于 2019-12-2 14:46:22 | 显示全部楼层
谢谢楼主，准备学习！！
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zhaoyk
发表于 2019-12-2 15:29:40 | 显示全部楼层
谢谢楼主的分享
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发表于 2019-12-3 08:06:54 | 显示全部楼层
谢谢 ！装了俩天了，各种毛病，心累，试试大佬的方法

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