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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2019-12-24 22:48:50 | 显示全部楼层
学习下
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发表于 2019-12-25 16:17:10 | 显示全部楼层
kank
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风动
发表于 2019-12-27 10:28:59 | 显示全部楼层
学习一下
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发表于 2019-12-27 13:38:03 | 显示全部楼层
谢谢分享！
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liult04
发表于 2019-12-27 15:09:39 | 显示全部楼层
感谢分享
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发表于 2019-12-30 10:43:57 | 显示全部楼层
thx for sharing~
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发表于 2020-1-2 19:57:38 | 显示全部楼层
看快看快看快看快看
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发表于 2020-1-13 10:55:48 | 显示全部楼层
谢谢分享
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AMD4400
发表于 2020-1-13 19:01:22 | 显示全部楼层
感谢感谢感谢感谢，参考学习学习学习
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chengzh
发表于 2020-1-24 11:56:38 | 显示全部楼层
感谢楼主分享
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