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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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littbi
发表于 2020-1-24 13:02:13 | 显示全部楼层
看看
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发表于 2020-1-26 18:27:08 | 显示全部楼层
感谢楼主分享
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发表于 2020-1-28 16:35:08 | 显示全部楼层
非常好
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MaxIII
发表于 2020-1-30 15:54:17 | 显示全部楼层
谢谢   
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发表于 2020-1-30 17:59:29 | 显示全部楼层
Good
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发表于 2020-1-31 18:48:57 | 显示全部楼层
学习学习，大神
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发表于 2020-2-1 11:19:21 | 显示全部楼层
感谢楼主分享！
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发表于 2020-2-7 13:50:36 | 显示全部楼层
Thanks your share
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发表于 2020-2-8 15:54:40 | 显示全部楼层
学习risc-v，进来看看怎么写
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zhangyp
发表于 2020-2-8 16:50:40 | 显示全部楼层
我也想看看
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