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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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IC_NEW
发表于 2022-7-12 09:20:24 | 显示全部楼层
看看
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发表于 2022-7-12 09:22:53 | 显示全部楼层
学习，感谢~
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itfor35
发表于 2022-7-12 10:15:45 | 显示全部楼层
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发表于 2022-7-12 11:00:43 | 显示全部楼层
感谢分享
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发表于 2022-7-12 11:18:00 | 显示全部楼层
一直想要个这样子的叫成功
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jfeta
发表于 2022-7-16 09:06:29 | 显示全部楼层
謝謝分享
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发表于 2022-7-16 18:44:41 | 显示全部楼层
Many thanks for your sharing
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Emma27
发表于 2022-7-20 16:10:45 | 显示全部楼层
混合仿真流程
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发表于 2022-7-21 00:05:33 | 显示全部楼层
感谢
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发表于 2022-7-21 00:46:54 | 显示全部楼层
学习，感谢~
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