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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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cwpeng
发表于 2022-6-29 15:48:47 | 显示全部楼层
感謝來看看有沒有用。
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temll
发表于 2022-6-30 18:55:28 | 显示全部楼层
KANKAN
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bulinnn
发表于 2022-7-1 03:37:30 | 显示全部楼层

谢谢分享！
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onlyking
发表于 2022-7-1 07:05:24 | 显示全部楼层
学习一下，谢谢楼主
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libra_hj
发表于 2022-7-1 08:27:32 | 显示全部楼层

thanks
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肉肉
发表于 2022-7-1 17:19:32 | 显示全部楼层
感谢
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jarvis_min
发表于 2022-7-1 22:27:01 | 显示全部楼层
学习
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yuynahong
发表于 2022-7-1 23:03:42 | 显示全部楼层
学习学习
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gehong
发表于 2022-7-5 21:36:26 | 显示全部楼层
感谢分享
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chen_or_KKK
发表于 2022-7-6 14:29:03 | 显示全部楼层
学习下
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