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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2022-8-6 14:46:44 | 显示全部楼层
感谢分享！！！
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发表于 2022-8-8 16:28:40 | 显示全部楼层

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eccsm9
发表于 2022-8-9 10:56:45 | 显示全部楼层
感谢
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zhamasi
发表于 2022-8-11 19:41:12 | 显示全部楼层
kankan
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Fbits
发表于 2022-8-12 14:34:31 | 显示全部楼层
谢谢
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z-xheng
发表于 2022-8-12 16:38:47 | 显示全部楼层
谢谢楼主分享
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发表于 2022-8-12 22:45:24 | 显示全部楼层
谢谢分享
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mooreZ
发表于 2022-8-15 10:03:45 | 显示全部楼层
谢谢分享
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发表于 2022-8-15 14:05:06 | 显示全部楼层
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发表于 2022-8-23 20:58:25 | 显示全部楼层
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