请教一个verilog语法?

psd0208 · 发表于 2014-3-5 20:39:57

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always块里的一个赋值语句: sig[(AA*8-1)-:8] <= {sig[((AA-1)*8-1)],sig[((AA-1)*8-2)-:7]};

AA是参数，值为3。

不明白那个“-”，啥意思？

kaka5358 · 发表于 2014-3-5 20:56:21

基本语法吧，sig[(AA*8-1)-:8]的目的就是：sig[(AA*8-1): (AA*8-1-8)]

psd0208 · 发表于 2014-3-5 21:01:20

回复 2# kaka5358
从来看到过从来没用过谢谢啊

flyelectron · 发表于 2014-3-6 10:20:49

这种就是装逼的写法，如果因为这个地方导致代码有问题，可能要花很久才能debug出来，做ic的还是建议老老实实写，不要这些花哨不实用的，要不然到时debug不出来，哭都来不及！

david1124 · 发表于 2014-3-6 11:22:24

That's not the recommented coding.

autim · 发表于 2014-3-6 14:56:15

D[A -:8] access arrar D, starting at D[A], ending at D[A -8]
D[A+:8] access arrar D, starting at D[A,] ending at D[A+8]

ctqiang · 发表于 2014-3-8 10:20:42

学习了

glace12123 · 发表于 2014-3-17 00:19:02

verilog的语法，是一群写程序代码的人弄出来的，但verilog，并不是计算机程序，而且结果出bug的风险比计算机程序更高，从硬件上可以无限创新，但编码上还是老老实实为好，否则就可能失去创新的资本

bworth · 发表于 2014-3-27 22:04:32

老老实实写

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