时钟同步

574920045 · 发表于 2013-7-18 13:52:09

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用代码来同步。clk1是100M，clk2是500K。代码如下：
reg clk_sys;
always @ (posedge clk1)
begin
clk_sys <= clk2;
end
这样子，用clk_sys来当500K的时钟使，挺好的。
看到一位网友这样做的，不知道行不行，有人解释一下吗！！

eaglelsb · 发表于 2013-7-18 15:36:54

可以，这个频率低，直接用寄存器输出当时钟用没问题。
或者有更通用方法，
always @(posedge clk1)
if(clk2 == 1'b1 && clk2_d == 1'b0)
q <= d;

element5 · 发表于 2013-7-18 16:01:31

clk_sys和clk2同频，但相位不同。

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fycjiewoo · 发表于 2013-7-21 10:17:55

clk1 和 clk2是同源的吗，不然可能会存在亚稳态问题？

教父 · 发表于 2013-7-22 15:12:07

这个你要看两个时钟的由来了

Gary.wang · 发表于 2013-7-22 16:58:43

比较山寨的做法，不建议使用。

2ki · 发表于 2013-7-22 21:41:38

直接使用clk2不更好？为啥这么做？

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