串转并

bao0756 · 发表于 2013-7-16 11:43:16

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reg[7:0] pal_out;always@(posedge clk or negedge rst)
if(!rst)
pal_out<=8'b0;
else

pal_out<={pal_out,srl_in}; 请问一下为什么这个能实现串转并能不能讲一下原理谢谢

hiloco · 发表于 2013-7-16 15:16:50

回复 1# bao0756

pal_out<={pal_out,srl_in};

左右位宽不相等

xayaya · 发表于 2013-7-16 16:34:05

这实际是pal_out[7:0]<={pal_out[6:0],srl_in};,这样每个时钟srl_in就是pal_out的最低位就实现了串转并

教父 · 发表于 2013-7-19 13:38:28

假设srl_in依次输入为1010；第一个周期 pal_out= 8‘b0000_0001, 第二个周期 pal_out= 8'b0000_0010,
第三个周期 pal_out= 8'b0000_0101, 第四个周期 pal_out= 8'b0000_1010，不知道这样说，能明白不？

bao0756 · 发表于 2013-7-23 11:36:56

谢谢大家解答

bao0756 · 发表于 2013-7-23 11:37:48

十分感谢大家的解答

xjwedh · 发表于 2013-7-24 21:53:30

真正的串转并后面应该还有逻辑吧

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