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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 在cadence 里如何仿真带verilog-A的模块？
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楼主: talanton

[求助] 在cadence 里如何仿真带verilog-A的模块？

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LZHSZM
发表于 2019-11-12 20:24:47 | 显示全部楼层
请问楼主解决了吗
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嵘儿
发表于 2019-11-15 10:51:27 | 显示全部楼层
谢分享
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stdq24
发表于 2019-12-3 15:32:28 | 显示全部楼层
不错的资料！！！！
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kayjep
发表于 2019-12-17 16:28:46 | 显示全部楼层
thanks for sharing
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发表于 2019-12-24 10:15:33 | 显示全部楼层
感谢 正需要这方面的信息
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发表于 2019-12-25 13:28:26 | 显示全部楼层
謝謝分享
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发表于 2020-1-14 20:15:46 | 显示全部楼层
留下脚印
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竍柒
发表于 2020-3-13 19:20:27 | 显示全部楼层
感谢
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发表于 2020-3-25 21:02:59 | 显示全部楼层
谢谢资料分享
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发表于 2020-6-24 09:41:55 | 显示全部楼层
多谢7楼关于verilog-a的资料
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