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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 暴多的verilog设计实例，均有原代码！！
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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

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发表于 2008-5-22 22:03:08 | 显示全部楼层
是不是忽悠人啊！？
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发表于 2008-5-25 18:30:28 | 显示全部楼层
看不到啊
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发表于 2008-5-27 10:47:12 | 显示全部楼层
哪儿搞到那么新的书
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发表于 2008-5-27 10:48:15 | 显示全部楼层
哪儿搞到那么新的书
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发表于 2008-6-15 00:32:34 | 显示全部楼层
谢谢啊，不错。
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发表于 2008-6-15 14:01:20 | 显示全部楼层
学学。。
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发表于 2008-6-15 17:05:09 | 显示全部楼层
xiexiexiexiexie LZ!
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sawfish
发表于 2008-6-16 00:04:12 | 显示全部楼层
Thanks!
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szj112
发表于 2008-6-16 15:28:02 | 显示全部楼层
顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶
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daist
发表于 2008-6-19 13:33:03 | 显示全部楼层
好东西啊！
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