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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 暴多的verilog设计实例，均有原代码！！
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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

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chamot
发表于 2008-7-28 12:34:01 | 显示全部楼层
thank you very much!!
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发表于 2008-8-8 10:19:01 | 显示全部楼层
bucuo , thanks
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发表于 2008-8-9 00:14:26 | 显示全部楼层
載來參考參考
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发表于 2008-8-9 00:15:32 | 显示全部楼层
載來參考參考
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dally
发表于 2008-8-11 00:58:52 | 显示全部楼层
Thanks
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发表于 2008-8-11 16:36:04 | 显示全部楼层
好东西  谢谢
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发表于 2008-8-11 21:18:58 | 显示全部楼层
很好很不错
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发表于 2008-8-11 21:19:44 | 显示全部楼层
学习学习
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发表于 2008-8-12 22:37:24 | 显示全部楼层
有100多個例子呀
我看大大小小都有囉
感謝你的分享
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illdan
发表于 2008-8-12 23:38:58 | 显示全部楼层
谢谢谢谢
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