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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 暴多的verilog设计实例，均有原代码！！
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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

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发表于 2007-7-4 22:34:29 | 显示全部楼层
kankan
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denap
发表于 2007-8-11 23:06:57 | 显示全部楼层
Thanks for sharing!!
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firi
发表于 2007-8-14 20:09:22 | 显示全部楼层
好东西，支持一下
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wangtou
发表于 2007-8-17 12:48:43 | 显示全部楼层
好东西
谢谢了
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adultsex
发表于 2007-8-26 23:21:19 | 显示全部楼层
好东西，支持一个
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tanrty4
发表于 2007-8-26 23:22:12 | 显示全部楼层
谢谢搂住分享
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发表于 2007-8-27 15:46:46 | 显示全部楼层
好书 好书 顶一下
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发表于 2007-8-27 21:24:13 | 显示全部楼层
的确是好东西哦！
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发表于 2007-8-27 21:28:59 | 显示全部楼层
好东西哦！十分感谢！
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发表于 2007-8-28 14:51:57 | 显示全部楼层
楼主好人啊!
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