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楼主: zhentizhi

暴多的verilog设计实例，均有原代码！！

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xmc214
发表于 2007-12-4 20:35:12 | 显示全部楼层
不错不错的,楼主辛苦啊
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ares10
发表于 2007-12-5 08:10:53 | 显示全部楼层
好东西
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hero_word
发表于 2007-12-6 08:54:21 | 显示全部楼层
dsadsadsas
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cbc007
发表于 2007-12-6 19:08:44 | 显示全部楼层
好东西，收藏了
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hero_word
发表于 2007-12-7 08:21:10 | 显示全部楼层
ding ding dgn ....
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wang610
发表于 2007-12-7 11:14:40 | 显示全部楼层
太猛了,感謝分享看起來是不錯的東西
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flyinglake
发表于 2007-12-8 15:45:23 | 显示全部楼层

ding

ding yi ge a
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wshuai_ic
发表于 2007-12-8 23:34:12 | 显示全部楼层
下
来看看
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kenanou
发表于 2007-12-9 14:43:43 | 显示全部楼层
thanks
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newfresh
发表于 2007-12-10 09:00:00 | 显示全部楼层
虽然我主要是学VHDL的,,,但还是顶一下,,,,学这东西,,,直接就拿着例子来做才能学到东西咧~
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