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查看: 10435|回复: 8

[讨论] 关于set_false_path的问题

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发表于 2011-12-19 08:53:44 | 显示全部楼层 |阅读模式

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逻辑综合时,异步时钟电路,已经set_false_path了,为什么check_timing的时候还报出这条路径unconstraint?
发表于 2011-12-19 09:34:05 | 显示全部楼层
unconstrained 就是false path的意思啊
发表于 2011-12-19 10:52:24 | 显示全部楼层
回复 2# icfbicfb


    不是这样的吧?
 楼主| 发表于 2011-12-19 13:52:34 | 显示全部楼层
回复 2# icfbicfb


    如:我设置set_false_path -from [get_clocks clk_a] -to [get_clocks clk_b]
                  set_false_path -from [get_clocks clk_b] -to [get_clocks clk_a]

check_timing 还是报出相关路径是是unconstraint,没有问题?还是说相关路径已经false掉了不该报出来了
 楼主| 发表于 2011-12-19 21:18:21 | 显示全部楼层
回复 5# zhq415758192


    报出的路径确定是异步的,起点的触发器由clk_a驱动,终点的触发器由clk_b驱动,这两个时钟是不同的时钟域
发表于 2011-12-20 09:23:53 | 显示全部楼层
既然是false path,  unconstrained 和 不报出来 有啥区别呢
发表于 2015-4-29 11:12:26 | 显示全部楼层
你好,我也遇到了这样的问题,请问你是怎么处理的?
发表于 2015-4-29 11:44:09 | 显示全部楼层
应该是这个flop的ck端没有被约束到, 你可以往前trace看看, 没法找到那个clk root ,

2个clk之间设了false path,是相当于有约束,不是unconstrained path
发表于 2015-5-9 09:37:37 | 显示全部楼层
异步和同步有何区别啊
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