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[求助] Block RAM问题

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发表于 2011-8-12 15:18:20 | 显示全部楼层 |阅读模式

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初学ISE 测试IP core 生成了一个单口RAM, 直接把个端口接出来,读写数据,发现读出的数据一致是00

该给的时序都给了,不知道是什么原因

代码如下:
module test_ram(
   input clk,
input [7:0] dina,
input [7:0] addr,
input wea,
input ssra,
output douta
    );
ram ram_t(
.clka(clka),
.dina(dina),
.addra(addra),
.wea(wea),
.ssra(ssra),
.douta(douta)
);  
endmodule

tb文件如下:
module tb;
// Inputs
reg clk;
reg [7:0] dina;
reg [7:0] addr;
reg wea;
reg ssra;
// Outputs
wire [7:0] douta;
// Instantiate the Unit Under Test (UUT)
test_ram uut (
  .clk(clk),
  .dina(dina),
  .addr(addr),
  .wea(wea),
  .ssra(ssra),
  .douta(douta)
);
initial begin
  // Initialize Inputs
  clk = 0;
  dina = 0;
  addr = 0;
  wea = 1;
  ssra=1;
  // Wait 100 ns for global reset to finish
  #100;
      ssra=0;  
  // Add stimulus here
end
always #10 clk=~clk;
always #20 begin dina=dina+1; addr=dina; end

endmodule

仿真图如下:
tt.JPG
 楼主| 发表于 2011-8-12 15:56:35 | 显示全部楼层
在线等啊~!~
发表于 2011-8-12 21:03:27 | 显示全部楼层
不知道是不是SSRA的问题,你试试把SSRA先1后0行不。
发表于 2011-8-13 10:31:57 | 显示全部楼层
有没有可能是没有编译库,无法仿真?
发表于 2011-8-15 08:23:37 | 显示全部楼层
在ISE10.1中,wea = 1是读状态;而在ISE13.1中,wea = 1是写状态的
看一下有没有弄混的啊
 楼主| 发表于 2011-8-15 09:27:58 | 显示全部楼层
不是复位和wea的问题,很是奇怪,搞不懂ISE了
发表于 2011-8-15 10:59:33 | 显示全部楼层
你什么时候写文件了?
 楼主| 发表于 2011-8-15 11:27:38 | 显示全部楼层
开机一直在写,觉得再怎么错误也该出个乱码吧,时钟,时能,数据都有
发表于 2011-8-15 16:44:14 | 显示全部楼层
只见写,不见读。
 楼主| 发表于 2011-8-15 16:52:01 | 显示全部楼层
单口RAM无论读写有地址和时钟就有数据输出啊
回复 9# jackertja
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