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楼主: raneewu

可综合的Verilog RISC CPU设计

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发表于 2013-11-18 17:25:20 | 显示全部楼层
就是夏宇闻那本教材里面的例子。。。。
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发表于 2014-1-2 09:54:37 | 显示全部楼层
谢谢楼主，下来看看
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ccarouse
发表于 2014-1-16 22:08:44 | 显示全部楼层
看看具体的设计~
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fanb1983
发表于 2014-1-20 17:57:22 | 显示全部楼层
这是什么呢？？
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发表于 2014-2-2 17:22:07 | 显示全部楼层
huitie
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Dochejj
发表于 2014-2-12 15:01:33 | 显示全部楼层
回复 1# raneewu

貌似很大的样子啊！
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发表于 2015-2-9 18:57:59 | 显示全部楼层
感谢分享！
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发表于 2015-2-24 14:12:14 | 显示全部楼层
kkkkkkkkkkkkkkkkkkkk
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发表于 2015-10-8 14:10:13 | 显示全部楼层
wo kankan
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发表于 2015-10-10 11:18:06 | 显示全部楼层
谢谢分享
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