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[求助] 关于生成锁存器的问题?

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发表于 2010-2-2 10:30:44 | 显示全部楼层 |阅读模式

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always @(posedge clk)
if(a==1)
b<=c;

这样一个语句因为没有else分支,所以被说可能被生成锁存器。但我有个疑问是,锁存器都是对电平敏感的,上面这个语句依然是对clk的边沿敏感的啊,怎么说是锁存器呢??

资料上说锁存器不能消除毛刺,如果上面语句,我觉得依然可以消除毛刺问题?
这个概念有点混乱,希望清楚的可以解释一下!!谢谢
发表于 2010-2-2 11:32:13 | 显示全部楼层
综合下,看下RTL级电路就知道了
发表于 2010-2-2 14:59:11 | 显示全部楼层
这个语言描述里 只有当a=1时 b<=c才成立 所以,其他情况下,这个值会被keep,所以会生成锁存器 只是他也是沿触发的  并不矛盾
发表于 2010-2-2 15:27:01 | 显示全部楼层
always @(posedge clk)
b<=c;
这样写就没latch了 体会下吧
发表于 2010-2-2 18:01:17 | 显示全部楼层
锁存器?寄存器?
发表于 2010-2-2 19:01:18 | 显示全部楼层
发表于 2010-2-2 20:11:04 | 显示全部楼层
胡说八道。。。。
怎么可能是锁存器呢,这是一个触发器加一个选择器。。。。。仔细想一下吧!!!!
发表于 2010-2-2 21:41:35 | 显示全部楼层
就是寄存器。 哪来的锁存器
发表于 2010-2-3 10:05:21 | 显示全部楼层
这是一个   带使能端的 D触发器
发表于 2010-2-3 10:57:26 | 显示全部楼层
嗯!触发器哈!
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