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楼主: lygg093

基于verilog 的同步FIFO设计

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stone_1979
发表于 2011-2-20 00:28:56 | 显示全部楼层
kan ka n...............
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mouchenjie
发表于 2011-4-26 16:45:20 | 显示全部楼层
thanks!
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dell_asic
发表于 2011-4-26 18:34:36 | 显示全部楼层
借鉴一下，
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328783724
发表于 2011-5-21 10:24:58 | 显示全部楼层
正需要这个代码，感谢啊~~~
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562332956
发表于 2011-6-1 17:44:29 | 显示全部楼层
thanks
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niuli
发表于 2011-6-7 10:29:08 | 显示全部楼层
简洁易用，真的挺好的，谢谢楼主~
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dianzidaren
发表于 2011-6-23 20:05:25 | 显示全部楼层
谢谢分享哈
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不野先生
发表于 2011-7-11 23:32:19 | 显示全部楼层
我要下载！！！！！！！！！！！！！！！！！！！！！！！
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anychao
发表于 2011-7-19 22:31:07 | 显示全部楼层
XIEXIE，不错
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anychao
发表于 2011-7-19 22:35:59 | 显示全部楼层
这代码，时钟沿和电平变量一起放在铭感列表里边？？？这也能综合???
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